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【在线】17秋福师《EDA技术》在线作业二一答案

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  • TA的每日心情
    开心
    2015-10-1 10:52
  • 签到天数: 2 天

    [LV.1]初来乍到

    发表于 2017-10-11 21:35:28 | 显示全部楼层 |阅读模式
    在线作业最低5元/门QQ 800003091 签到获取发帖权限
    【在线】17秋福师《EDA技术》在线作业二
        1   多选题

    1. PLD是一种半定制器件,主要包括()。
      壹. FPGA
      贰. CPLD
      叁. CPU
      肆. ASIC
    标准结果: 满分:2

    2. 衡量仿真器性能的重要指标有哪些()。
      壹. 仿真速度
      贰. 仿真的准确性
      叁. 仿真的易用性
    标准结果: 满分:2

    3. 目前常用的硬件描述语言为:()。
      壹. Verilog
      贰. VHDL
      叁. 和 VC
      肆. VB
    标准结果: 满分:2

    4. 常用的综合工具有哪些()。
      壹. FPGA Express
      贰. FPGA compiler
      叁. Synplify Pro
    标准结果: 满分:2

    5. 状态机常用的编码方式有()。
      壹. 顺序编码
      贰. 格雷编码
      叁. 约翰逊编码
      肆. 一位热码
    标准结果: 满分:2

    6. IP核一般分为哪几种()。
      壹. 硬核
      贰. 固核
      叁. 软核
      肆. 以上全不对
    标准结果: 满分:2

    7. EDA技术发展阶段描述正确的是()。
      壹. CAD阶段
      贰. CAE阶段
      叁. EDA阶段
      肆. 以上都不对
    标准结果: 满分:2

    8. 下面哪些是专业提供PLD器件厂商()。
      壹. Xilinx
      贰. Altera
      叁. Lattice
      肆. Micsoftware
    标准结果: 满分:2

    9. TOP-down设计一般分为哪几个层次()。
      壹. 系统级
      贰. 功能级
      叁. 门级
      肆. 开关级
    标准结果: 满分:2

    10. 常用的集成FPGA/CPLD开发工具有哪些()。
      壹. MAX+plus II
      贰. Quartus II
      叁. ISE
      肆. ispLEVER
    标准结果: 满分:2

       


        2   判断题

    1. JTAG是Joint Test Action Group, 联合测试行动组的缩写。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    2. 行为描述就是对设计实体的数学模型的描述,其抽象程度远高于结构描述。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    3. FPGA是Field Programmable Gate Array,现场可编程门阵列的缩写。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    4. ASIC一般采用全定制方法来实现设计。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    5. Alter的FPGA器件主要由两类配置方式:主动配置方式和被动配置方式。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    6. 如果只需要在上电和系统错误时进行复位操作,采用异步复位方式比同步复位方式好。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    7. PLA是Programmable Logic Array,可编程逻辑阵列的缩写。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    8. 反熔丝型开关元件一般用在对可靠性要求较高的军事和航天产品器件上。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    9. 在IC设计领域中,IP核一般完成某种功能的设计模块。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    10. 解释型仿真器速度慢一些,但可以随时修改仿真环境和仿真条件。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    11. CPLD和FPGA都属于高密度可编程逻辑器件。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    12. 有限状态机的复位分为两种:同步复位和异步复位。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    13. PLD是一种全定制器件。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    14. 布局布线为将综合生成的电路逻辑网表映射到具体的目标器件中实现,并产生最终的可下载文件的过程。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    15. GAL是Generic Array Logic,通用阵列逻辑的缩写。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    16. 状态机可以分为:米里型和摩尔型两类。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    17. Verilog HDL中的变量一般分为两种数据类型:net型和variable型。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    18. HDL是Hardware Description Language,硬件描述语言的缩写。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    19. Verilog语言的行为描述语句,如条件语句、赋值语句和循环语句类似于软件高级语言,便于学习和使用。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    20. 用状态机进行设计具有速度快、结构简单、可靠性高等优点。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    21. SOC是指把一个完整的系统集成在一个芯片上。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    22. Verilog HDL中整数型常量是不可以综合的。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    23. 时序仿真也叫后仿真。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    24. Verilog HDL和 VHDL目前还都不是IEEE标准。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    25. PLD器件的设计往往采用层次化的设计方法,分模块,分层次地进行设计描述。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    26. Verilog HDL语法要素与软件编程语言(如C语言)是完全相同的。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    27. 目前常用的硬件描述语言为:Verilog HDL和 VHDL。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    28. PLD器件内部主要由各种逻辑功能部件和可编程开关构成。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    29. 把适配后生成的编程文件装入到PLD器件中的过程称为下载。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    30. IP核中的硬核可靠性高,能确保性能,能够很快投入使用。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    31. Verilog HDL中的常量主要有:整数,实数和字符串
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    32. Verilog HDL中实数型和字符串型常量是可以综合的。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    33. 混合仿真器就是能同时支持Verilog和VHDL的仿真器。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    34. SOC是System On Chip,芯片系统的缩写。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    35. ISP和专用的编程器是FPGA常用的两种编程方式。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    36. Verilog HDL支持赋值语句。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    37. 对设计而言,采用的描述级别越高,设计越容易。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    38. 目前在数字系统的设计中,主要采用Bottom-UP设计为主。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    39. Synplify是一种FPGA/CPLD的逻辑综合工具。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    40. Verilog HDL数据类型是用来表示数字电路中的物理连线、数据存储和传输单元等物理量的。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

       
    【在线】17秋福师《EDA技术》在线作业一
        1   多选题

    1. 用PLD器件实现设计的优势有哪些()?
      壹. 周期短
      贰. 投入少
      叁. 风险小
      肆. 对于成熟的设计往往采用PLD
    标准结果: 满分:2

    2. 状态机常用的编码方式有()。
      壹. 顺序编码
      贰. 格雷编码
      叁. 约翰逊编码
      肆. 一位热码
    标准结果: 满分:2

    3. 综合有哪几种形式()。
      壹. RTL
      贰. 逻辑综合
      叁. 将逻辑门表示转换到版图表示
    标准结果: 满分:2

    4. 基于FPGA/CPLD器件的数字系统设计流程包括哪些阶段()。
      壹. 设计输入
      贰. 综合
      叁. 布局布线
      肆. 仿真和编程
    标准结果: 满分:2

    5. PLD是一种半定制器件,主要包括()。
      壹. FPGA
      贰. CPLD
      叁. CPU
      肆. ASIC
    标准结果: 满分:2

    6. 目前常用的硬件描述语言为:()。
      壹. Verilog
      贰. VHDL
      叁. 和 VC
      肆. VB
    标准结果: 满分:2

    7. 常用的综合工具有哪些()。
      壹. FPGA Express
      贰. FPGA compiler
      叁. Synplify Pro
    标准结果: 满分:2

    8. 基于EDA技术的设计中,通常有两种设计思路()。
      壹. 自顶向下
      贰. 自底向上
      叁. 自前向后
      肆. 自后向前
    标准结果: 满分:2

    9. 下面哪些是专业提供第三方EDA软件工具的公司()。
      壹. Cadence
      贰. Mentor
      叁. Synopsys
      肆. Synplicity
    标准结果: 满分:2

    10. 布局布线完成后会产生哪些文件()。
      壹. 芯片资源耗用的报告
      贰. EDIF
      叁. 延时网表
      肆. 器件编程文件
    标准结果: 满分:2

       


        2   判断题

    1. 有限状态机的复位分为两种:同步复位和异步复位。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    2. 反熔丝型开关元件一般用在对可靠性要求较高的军事和航天产品器件上。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    3. 采用原理图方式的数字设计的可重用性、可移植要差一些。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    4. GAL是Generic Array Logic,通用阵列逻辑的缩写。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    5. PLD器件内部主要由各种逻辑功能部件和可编程开关构成。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    6. 目前在数字系统的设计中,主要采用Bottom-UP设计为主。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    7. JTAG边界扫描测试技术提供了一种合理而有效的方法,用以对高密度、引脚密集的器件和系统进行测试。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    8. 综合指的是将较高级抽象层次的设计描述自动转化为较低层次描述的过程。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    9. Verilog HDL中assign为持续赋值语句。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    10. IP是Intellectual Property的缩写。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    11. 时序仿真也叫后仿真。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    12. EDA是Electronic Design Automation,电子设计自动化的缩写。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    13. Verilog HDL不支持条件语句。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    14. HDL是Hardware Description Language,硬件描述语言的缩写。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    15. 数字设计流程中采用原理图方式适合描述电路的连接关系核接口关系。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    16. 仿真是EDA的精髓所在。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    17. 绝大多数的FPGA器件都基于SRAM查找表结构实现。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    18. 在IC设计领域中,IP核一般完成某种功能的设计模块。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    19. Verilog语言即适合可综合的电路设计,也可胜任电路与系统的仿真。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    20. Verilog HDL支持赋值语句。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    21. IP核中的软核与生产工艺无关,不涉及物理实现,为后续设计留有很大空间。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    22. PROM(Programmable Read-Only Memory),可编程只读存储器的缩写。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    23. 有限状态机非常适合于数字系统的控制模块。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    24. PLA是Programmable Logic Array,可编程逻辑阵列的缩写。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    25. Verilog HDL语法要素与软件编程语言(如C语言)是完全相同的。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    26. Synplify是一种FPGA/CPLD的逻辑综合工具。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    27. CPLD和FPGA都属于高密度可编程逻辑器件。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    28. 在EDA设计中一般采用硬件描述语言(HDL)进行电路与系统的描述。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    29. 不考虑信号时延等因素的仿真称为功能仿真。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    30. 仿真分为功能仿真和时序仿真。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    31. 布局布线为将综合生成的电路逻辑网表映射到具体的目标器件中实现,并产生最终的可下载文件的过程。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    32. Verilog HDL中的常量主要有:整数,实数和字符串
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    33. 目前常用的硬件描述语言为:Verilog HDL和 VHDL。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    34. 数据流描述方式多用于组合逻辑电路。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    35. SOC是指把一个完整的系统集成在一个芯片上。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    36. Verilog HDL中实数型和字符串型常量是可以综合的。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    37. 编译型仿真器的仿真速度快,但需要预处理,不能即时修改。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    38. 数字设计流程中的设计输入的表达方式一般有原理图方式和HDL文本方式两种。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    39. PLD是一种全定制器件。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

    40. 仿真也称模拟,是对所设计电路的功能的验证。
      壹. 错误
      贰. 正确
    标准结果: 满分:2

       






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